回复：高速缓冲存储器

当用虚地址访问主存时，机器自动地把它经辅助软件、硬件变换成主存实地址。查看这个地址所对应的单元内容是否已经装入主存，

如果在主存就进行访问，如果不在主存内就经辅助软件、硬件把它所在的那块程序和数据由辅存调入主存，而后进行访问。

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这些操作都不必由程序员来安排，也就是说，对应用程员员是透明的。主-辅存层次解决了存储器大容量要求和低成本之间的矛盾。

在速度方面，计算机的主存和CPU直保持了大约一个数量级的差距。显然这个差距限制了CPU速度潜力的发挥。为了弥合这个差距

，仅采用一种工艺的单一存储器是行不通的，必须进一步从计算机系统结构和组织上去研究。设置高速缓冲存储器（Cache）

是解决存取速度的重要方法。在CPU和主存中间设置高速缓冲存储器

构成高速缓存（Cache）-主存层次，要求Cache在速度上能跟得上CPU的要求

Cache-主存间的地址映象和调度吸取了比它较早出现的主-辅存存储层次的技术，不同的是因其速度要求高，不是由软、硬件结合而完全由硬件来实现，如图所示。

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地址映象与转换地址映象是指某一数据在内存中的地址与在缓冲中的地址，两者之间的对应关系

下面介绍三种地址映象的方式

1.全相联方式

地址映象规则：主存的任意一块可以映象到Cache中的任意一块

(1) 主存与缓存分成相同大小的数据块。

2) 主存的某一数据块可以装入缓存的任意一块空间中。如果Cache的块数为Cb，主存的块数为Mb，则映象关系共有Cb×Mb种。

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目录表存放在相关（联）存储器中，其中包括三部分：数据块在主存的块地址、存入缓存后的块地址、及有效位（也称装入位）

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