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求助,用allegro HDL设计原理图

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  • 上帝的柿饼刚8岁
  • 电路白丁
    1
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
网上cadence全是orcad的教学,但是因为工作单位归档问题,只能用HDL,这玩意操作逻辑逆天。有没有有人熟悉HDL的啊


  • 上帝的柿饼刚8岁
  • 电路白丁
    1
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
或者能不能用orcad画完原理图,再转成hdl的?网上只说元器件库可以转格式,不知道原理图行不行


2026-08-30 10:23:53
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不感兴趣
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  • 上帝的柿饼刚8岁
  • 电路白丁
    1
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
本人用的cadence 17.2


  • 下雨天出太阳恩
  • 电路白丁
    1
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
我也是,找不到HDL学习资料


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